crafts/NYA-SCDIF/仕様
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開始行:
*仕様 [#sda79fc4]
|>|項目|RevB|RevC|h
|入力|LRCK|32/64/66.2kHz LRチャンネル極性選択可能|同左|
|~|BCK|64fs以下/256fs&br;最大8.192MHz|同左|
|~|SDAT|16/18/20/24bit MSBファースト右詰|同左|
|出力|SPDIF仕様|24bit 32/48/96kHz|24bit 32/44.1/48/96kHz|
|~|クロック源|水晶発振器(入力非同期)|LRCK+PLL(入力同期)もしくは水晶発振子+PLL(入力非同期)|
|~|出力遅延|約2ms(理論値)|同左|
|~|サンプリングレート変換方法|64/66.2kHz->32/48kHz：余剰データ間引き&br;32kHz->48kHz,32/64/66.2kHz->96kHz：不足データは直前データで補完&br;※中間値での補完機能なし|64/66.2kHz->32/44.1/48kHz：余剰データ間引き&br;32kHz->44.1/48kHz,32/64/66.2kHz->96kHz：不足データは直前データで補完&br;※中間値での補完機能なし|
|~|分解能変換方法|LSB基準合わせ(入力16bitであれば8bit左シフト)|同左|
|その他|USB|VID:04D8 PID:E523&br;USB2.0 HIDデバイス|同左|
|~|消費電力|5V 200mA以下|5V 600mA以下|
*RevC バージョン情報 [#md56bda5]
|リビジョン|ファームウェアバージョン|説明|h
|RevC.0|Ver0|2026/04/26 初期バージョン|
*RevB バージョン情報 [#d79dcbb1]
|リビジョン|ファームウェアバージョン|説明|h
|RevB.0|Ver0|2025/03/18 初期バージョン|
|~|Ver1|2025/08/03 入出力同期調整ロジック修正|
|~|Ver2|2025/08/31 出力MODE2追加|
終了行:
*仕様 [#sda79fc4]
|>|項目|RevB|RevC|h
|入力|LRCK|32/64/66.2kHz LRチャンネル極性選択可能|同左|
|~|BCK|64fs以下/256fs&br;最大8.192MHz|同左|
|~|SDAT|16/18/20/24bit MSBファースト右詰|同左|
|出力|SPDIF仕様|24bit 32/48/96kHz|24bit 32/44.1/48/96kHz|
|~|クロック源|水晶発振器(入力非同期)|LRCK+PLL(入力同期)もしくは水晶発振子+PLL(入力非同期)|
|~|出力遅延|約2ms(理論値)|同左|
|~|サンプリングレート変換方法|64/66.2kHz->32/48kHz：余剰データ間引き&br;32kHz->48kHz,32/64/66.2kHz->96kHz：不足データは直前データで補完&br;※中間値での補完機能なし|64/66.2kHz->32/44.1/48kHz：余剰データ間引き&br;32kHz->44.1/48kHz,32/64/66.2kHz->96kHz：不足データは直前データで補完&br;※中間値での補完機能なし|
|~|分解能変換方法|LSB基準合わせ(入力16bitであれば8bit左シフト)|同左|
|その他|USB|VID:04D8 PID:E523&br;USB2.0 HIDデバイス|同左|
|~|消費電力|5V 200mA以下|5V 600mA以下|
*RevC バージョン情報 [#md56bda5]
|リビジョン|ファームウェアバージョン|説明|h
|RevC.0|Ver0|2026/04/26 初期バージョン|
*RevB バージョン情報 [#d79dcbb1]
|リビジョン|ファームウェアバージョン|説明|h
|RevB.0|Ver0|2025/03/18 初期バージョン|
|~|Ver1|2025/08/03 入出力同期調整ロジック修正|
|~|Ver2|2025/08/31 出力MODE2追加|
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